積體電路、數位鎖頻迴路、及使用數位鎖頻迴路之方法 INTEGRATED CIRCUIT, DIGITAL FREQUENCY LOCKED LOOP AND METHOD OF USING THE DIGITAL FREQUENCY LOCKED
申請人· 輝達科技英國有限公司 NVIDIA TECHNOLOGY UK LIMITED 英國 GB


專利信息

專利名稱 積體電路、數位鎖頻迴路、及使用數位鎖頻迴路之方法
公告號 I517587
公告日 2016/01/11
證書號 I517587
申請號 2011/02/23
國際專利分類號
公報卷期 43-02
發明人 菲力克斯 史蒂芬 FELIX, STEVE
申請人 輝達科技英國有限公司 NVIDIA TECHNOLOGY UK LIMITED 英國 GB
代理人 惲軼群; 陳文郎
優先權 英國 1003030.2 20100223
參考文獻 US6414527B1; US6973145B1; US7358785B2; US2007/0096781A1; US2007/0096781A1; US2009/0189653A1
審查人員 劉明諭

專利摘要

用以產生一時鐘信號的積體電路及方法,該積體電路包含(i)一鎖頻迴路,其包含一壓控振盪器,其配置為接收一控制輸入及產生由該控制輸入確定的一時鐘信號;及(ii)一微處理器,其配置為由一供應電壓供電及接收由該壓控振盪器所產生的該時鐘信號。該積體電路配置為使用該供應電壓作為該控制輸入,使得該時鐘信號由該供應電壓來確定。


專利範圍

1.一種積體電路,其包含:一鎖頻迴路,其包含組配來接收一控制輸入及產生由該控制輸入決定的一時鐘信號的一壓控振盪器;以及一微處理器,其組配為由一供應電壓供電及接收由該壓控振盪器所產生的該時鐘信號,其中該積體電路組配來使用該供應電壓作為該控制輸入,使得該時鐘信號由該供應電壓決定,及其中該壓控振盪器組配來接收一數位控制參數,該時鐘信號係取決於該數位控制參數及該供應電壓,其中該供應電壓與由該壓控振盪器所產生之該時鐘信號之頻率之間的關係由該數位控制參數予以決定,及其中該數位控制參數係可調整,使得該時鐘信號之頻率可減小,同時維持該供應電壓於一可接受之電壓範圍內。 2.如申請專利範圍第1項所述之積體電路,其中該鎖頻迴路進一步包含用以接收由該壓控振盪器所產生的該時鐘信號且用以依賴該時鐘信號來調整該供應電壓的回饋控制裝置。 3.如申請專利範圍第2項所述之積體電路,其中該回饋控制裝置組配來接收一回饋控制值,且組配來依賴該回饋控制值來調整該供應電壓。 4.如申請專利範圍第3項所述之積體電路,其中該回饋控制裝置組配來調整該供應電壓,使得由該壓控振盪器所產生的該時鐘信號之頻率由該回饋控制值來決定。 5.如申請專利範圍第3項所述之積體電路,其中該回饋控制值包含一參數M及具有頻率Fref的一參考頻率信號。 6.如申請專利範圍第3項所述之積體電路,其中該回饋控制裝置組配來藉由調整該供應電壓以在可藉由設定一第二回饋控制值來控制的一響應時間內達到一調整穩定位準來響應該回饋控制值的變化。 7.如申請專利範圍第6項所述之積體電路,其中該第二回饋控制值被設定成使得用以響應導致該供應電壓增大的該回饋控制值中的一變化的響應時間,比用以響應導致該供應電壓減小的該回饋控制值中的一變化的響應時間短。 8.如申請專利範圍第6項所述之積體電路,其中該第二回饋控制值被設定使得藉由改變該回饋控制值使得該供應電壓增大所引起的該供應電壓的過衝(overshoot)量值大於藉由改變該回饋控制值使得該供應電壓減小所引起的該供應電壓之欠衝(undershoot)量值。 9.如申請專利範圍第1項所述之積體電路,其中該鎖頻迴路為一數位鎖頻迴路且該時鐘信號為一數位時鐘信號。 10.如申請專利範圍第1項所述之積體電路,其中有回饋控制裝置包含用以產生一類比信號的一數位對類比轉換器。 11.如申請專利範圍第10項所述之積體電路,其中該回饋控制裝置


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專利資訊及圖示來源: 中華民國專利資訊檢索系統