交叉點陣列之小型插座連接 COMPACT SOCKET CONNECTION TO CROSS-POINT ARRAY
申請人· 英特爾股份有限公司 INTEL CORPORATION 美國 US


專利信息

專利名稱 交叉點陣列之小型插座連接
公告號 I517331
公告日 2016/01/11
證書號 I517331
申請號 2013/05/27
國際專利分類號
公報卷期 43-02
發明人 裴利瑟 菲碧歐 PELLIZZER, FABIO; 瑞格諾 安東尼 RIGANO, ANTONINO; 卡貝堤 吉安菲 CAPETTI, GIANFRANCO
申請人 英特爾股份有限公司 INTEL CORPORATION 美國 US
代理人 林志剛
優先權 美國 13/538,880 20120629
參考文獻 US2008/0232160A1; US2012/0106252A1
審查人員 陳建仲

專利摘要

積體電路可包括橫截交叉點陣列之線,在第一層上在第一間距製造該些線,其中該第一間距為次光刻;及在第二層上之引線,該些引線具有為該第一間距兩倍大之第二間距。可在交替群中於該陣列外部路由該些線至該陣列的相對側,在該相對側該些線耦合至該些引線。


專利範圍

1.一種積體電路,包含:橫截交叉點陣列之線,該些線在第一層上具有次光刻第一間距;在第二層上之引線,該些引線具有約為該第一間距兩倍大之第二間距;及插座區域,其中一群線具有從該群線延伸於相同垂直方向的區,以於該插座區域中耦合與一外側組引線及一內側組平行引線,該些外側組引線係朝向彼此而延伸;其中在交替群中於該陣列外部路由該些線至該陣列的相對側以耦合至該些引線。 2.如申請專利範圍第1項所述之積體電路,其中一群線包含兩個相連的四線組,其轉離彼此而在該插座區域中創造為該第一間距的16倍寬之垂直區,且該群線藉由在該插座區域中之該第一與第二層之間的通孔耦合到兩個四引線組。 3.如申請專利範圍第2項所述之積體電路,其中該插座區域相鄰該陣列。 4.如申請專利範圍第2項所述之積體電路,其中該些垂直區結束於離該插座區域的一側之等於至少該第一間距的一距離。 5.如申請專利範圍第2項所述之積體電路,其中一群引線包含該兩個四引線組;該群線中之一個四線組的路由路徑為該群線中之另一個四線組的路由路徑之鏡像;及該群引線中之一個四引線組的路由路徑為該群引線中之另一個四引線組的路由路徑之鏡像。 6.如申請專利範圍第2項所述之積體電路,進一步包含位在該插座區域與該陣列之間的裁切區域,其中交替群的線終止在該裁切區域中。 7.如申請專利範圍第6項所述之積體電路,其中該些交替群的線耦合至在自該插座區域該陣列的相對側上的其他引線。 8.如申請專利範圍第2項所述之積體電路,其中一個四線組耦合至一個四引線組,該四引線組包括中間兩條引線和外側兩條引線,該些垂直區包括最接近其中該些引線進入該插座區域之該插座區域的一側之第一兩個垂直區域,及最遠離其中該些引線進入該插座區域之該插座區域的該側之第二兩個垂直區域;該些中間兩條引線進入該插座區域且分別耦合至該些第一兩個垂直區;及該些外側兩條引線進入該插座區域,轉向彼此,並耦合至該些第二兩個垂直區。 9.如申請專利範圍第8項所述之積體電路,其中該四引線組進入與該四線組進入該插座區域相對之該插座區域的一側,且該些第一兩個垂直區比該些第二兩個垂直區更遠離該陣列。 10.如申請專利範圍第8項所述之積體電路,其中該四引線組及該四線組進入最接近該陣列之該插座區域的一側,且該些第一兩個垂直區比該些第二兩個垂直區更接近該陣列。 11.如申請專利範圍第8項所述之積體電路,其中該些外側兩條引線之離該


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專利資訊及圖示來源: 中華民國專利資訊檢索系統