一種有效降低射頻電路佈局面積之方法 AN AREA EFFICIENT LAYOUT METHOD FOR RFICS
申請人· 曾彥儒 TZENG, YAN RU 南投縣埔里鎮大學路1號 電機系


專利信息

專利名稱 一種有效降低射頻電路佈局面積之方法
公告號 200634865
公告日
證書號
申請號 2005/03/18
國際專利分類號
公報卷期 04-19
發明人 陳嘉倫;林佑昇 LIN, YO SHENG;曾彥儒 TZENG, YAN RU
申請人 曾彥儒 TZENG, YAN RU 南投縣埔里鎮大學路1號 電機系
代理人
優先權
參考文獻
審查人員

專利摘要

一種有效降低射頻電路佈局面積之方法簡圖

本發明提出之電感器結構,其具有兩個以上的獨立電流路徑。換句話說,此種電感器具有三個以上的埠。此種電感器主要用途為積體電路,特別是射頻電路之阻抗匹配電路。由於所提出之電感器結構可取代兩個以上的傳統電感器,所以可以大幅降低射頻電路之佈局面積。一個典型電路應用之實施例包括一平面或垂直的螺旋導體。一第一電子元件及第二電子元件,此螺旋導體有第一端點和第二端點,第一端點為導體的第一埠;導體之中間分接端為導體之第二埠;第二端點為導體之第三埠。第一電子元件的第一端連接於導體之第一埠;第二端連接導體之第二埠。且第一電子元件之電流係由第一端流到第二端。第二電子元件有一第三端點,其係連接到導體之第三埠,其操作類似電流源或電流汲。


專利範圍

1.電路佈局申請範圍:一電路包含一螺旋電感,該螺旋導體有兩個端點分別為第一端點和第二端點,其第一端點為導體的Port-1,導體的中間部份分接出來為Port-2,第二端點為導體的Port-3;從Port-1進Port-2出的此元件,可使電流流經過此線段;從Port-2進Port-3出的此元件操作如電流源或電流汲。
2.如申請專利範圍第1項,Port-2進Port-3出的元件一場效應電晶體(FET),電晶體的閘極(gate)係與接收電流的Port-3連接在一起。
3.如申請專利範圍第2項,從Port-1進Port-2出的此元件包含一個電容。
4.如申請專利範圍第1項,從Port-1進Port-2出的此元件包含一個電容。
5.如申請專利範圍第1項,螺旋導體係位於積體電路(IC)的金屬層上。
6.如申請專利範圍第5項,從Port-2進Port-3出的此元件包含一位於積體電路(IC)中之場效應電晶體(FET),電晶體的閘極(gate)係與接收電流的Port-3連接在一起。
7.如申請專利範圍第2項,從Port-1進Port-2出的此元件包含一位於積體電路(IC)中之電容。
8.電路申請範圍:電路的輸入級有一螺旋導體和一電容,螺旋導體有第一端(Port-1)、第二端(Port-3)和中間端(Port-2),電容係連接於電感之第一端(Port-1)和中間端(Port2)之間;而場效應電晶體(FET)的閘極(gate)係連接螺旋導體的第二端(Port-3),可接收來自螺旋電感(Port-3)的電流。
9.如申請專利範圍第8項,螺旋導體和電容合在一起置於放大器的第一級,要同步接收來自螺旋導體第一端的信號,至少要有兩個阻抗匹配好的頻段。
10.如申請專利範圍第8項,更進一步包含一第二電容,其連接螺旋導體第二端(Port-3)與場效應電晶體(FET)的閘極(gate)一起。
11.如申請專利範圍第8項,更進一步包含半導體基板和製作在該基板上之螺旋導體、電晶體、電容。
12.如申請專利範圍第11項,螺旋導體係以之金屬層所被製作。
13.如申請專利範圍第11項,此螺旋導體之第一端至中間端部分係製作於基板上之某一層金屬層上,而中間端至第二端部分係製作於同一金屬或另一金屬層上。


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專利資訊及圖示來源: 中華民國專利資訊檢索系統